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Module Archi pour le TNS

Déroulement du cours

4h en 2 séances

- Objectifs :

  1. Savoir décrire une chaîne de traitement du signal (modélisation système)
  2. Savoir choisir/utiliser une représentation des nombres et mettre en oeuvre les opérateurs associés
  3. Savoir implémenter un filtrage 1D logiciel(gestion des données, structure algorithmique, organisation du calcul)
  4. Savoir séquencer temporellement le calcul et garantir des contraintes temps-réel
  5. Disposer de quelques éléments de dimensionnement pour le choix d'une architecture

- Présentation d'une chaîne générique de traitement numérique du signal (cours 1)

  1. acquisition
  2. calcul
  3. génération
  4. interfaces de contrôle

- Représentation des données (cours 1)

  1. Virgule fixe
    1. Opérateurs de calcul et problèmes associés (saturation, troncation)
    2. Dimensionnement des types selon le calcul
  2. Nombres flottants
    1. simple, double, demi …
    2. problèmes du float

- Traitement du signal logiciel (cours 1)

  1. Sous interruption
  2. Cadencé par les données
  3. Stockage des données (buffer circulaire, fifo …)
  4. Temps réel ou non … (latence, cadence)
    1. en ligne
    2. hors ligne
    3. par bloc

- Convertisseurs (DAC/ADC)

  1. Bruit d'échantillonage
  2. FIFO/DMA
  3. Multiplexage

- Implémentation matérielle pour le filtrage (Cours 2)

  1. Chemin de données
  2. Opérateurs et types
    1. MAC
    2. Multiplier (Cyclone)
  3. Pipeline vs Séquentiel
  4. Cadencement du calcul
  5. Problèmes de domaine d'horloge

Déroulement du TD

4h en 2 séances

TD 1

  1. manipulation des nombres en virgule fixe
  2. dimensionnement et application à une équation de récurence

- Démarche de mise au point, ex: du filtre FIR (TD)

Finalement pas dans le TD1:

  1. Conception du filtre (génération des coefficients)
  2. Compromis d'implémentation
  3. Test unitaire
  4. Tests de conformité par rapport à la “golden” reference
    1. Qualité de la réponse filtre

TD 2

- Spécificités de l'implémentation sur microcontroleur

  1. Périphériques:
    1. ADC
    2. DAC
    3. Timer
    4. Interruptions
    5. Dimensionnement de l'ALU et des éventuelles fonctions/instructions DSP
  2. Dimensionnement des calculs en fonction des périphériques
  3. Adéquation complexité du filtre/architecture du micro(DSP)

Déroulement du TP

14h en 7 séances

- Implémentation logiciel pur du filtre sous Qt (de merde)

  1. TP1:
    1. Générer des échantillons (pulse, sin)
    2. Visualisation des données numériques en numéro d'échantillon
    3. Premier filtre FIR (S(k) = E(k)) → Fonction de recopie unitaire
    4. Deuxième filtre Sk = E(k-r) (gestion de la file)
    5. Echo
  1. TP2:
    1. Implémentation filtre FIR sur la base du TP1 en double précision et visualisation
      1. Test de validité bourrin (affichage de la réponse impulse et module |H(f)| de la FdT)
    2. Codage du FIR en virgule fixe
  1. TP3: pt de synchro : Arduino
    1. plug de la fonction filtre
    2. vérification des aspects temps réel
    3. it timer fournie
  1. TP4: pt de synchro Nucleo JOJO FAIT TOUT!!!!!!!!!!!!!!!!!!!!!
  2. TP5:
  3. TP6:
  4. TP7:
archi_tns.txt · Dernière modification: 2015/03/08 13:27 par bvandepo